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Channel
number
1
2
3
4
5
6
7
Priority level
setting
Default
Default
Default
Default
Default
Default
Default
Descending order of
channel priority
-
-
-
-
-
-
Lowest-priority DMA channel
After a DMA transfer completes, the controller polls all the DMA channels that are available. Figure 8.2 (p.
42) shows the process it uses to determine which DMA transfer to perform next.
Figure 8.2. Polling flowchart
Start polling
Is there
a channel
request ?
Yes
Are any
channel requests
using a high priority-
level ?
Yes
N
o
No
Select channel that has
the lowest channel
num ber and is set to
high priority-level
Select channel that has
the lowest channel
num ber
Start DMA transfer
8.4.2.3 DMA cycle types
The cycle_ctrl bits control how the controller performs a DMA cycle. You can set the cycle_ctrl bits as
Table 8.3 (p. 42) lists.
Table 8.3. DMA cycle types
cycle_ctrl
b000
b001
Description
Channel control data structure is invalid
Basic DMA transfer
2011-04-12 - d0001_Rev1.10
42
www.energymicro.com
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